1樓：海貓絡合物
一般來說頻率不大會差別這麼大的，鎖相環一般包括倍頻和分頻器，真是的值是晶振時鐘*倍頻/分頻，所以樓主看一下是不是分頻器有設定。
keil預設使用哪個時鐘不是很清楚，lpc好像有rc時鐘和晶振時鐘兩種選擇的，看一下startup檔案中相應的暫存器是怎麼設定的就知道了，再不行就自己在main的初始化中設定時鐘源。
另外我不知道樓主晶元頻率是怎麼測試的，要是通過軟體發出波形的話是測量不準的，需要通過定時器或者pwm來產生訊號，再通過示波器捕捉才能準確判斷。
2樓：網友
廠家的測試條件是比較苛刻的，倍頻120m，程式是可以跑，但是，可能存在隱患，說不定什麼時候跑飛了。
keil預設用的內部rc時鐘吧。
3樓：網友
呵呵，這就像intel賣cpu一樣，體質好，能上高倍頻的就標高頻，體質不好的就標低頻，其實都是一條流水線上下來的，結果大家買了很多低頻的玩超頻。你其實也是買到塊體質較好的，在玩超頻，平時玩玩是可以的，但如果你要做專案，建議你還是老老實實降到它標稱頻率吧。
求助關於鎖相環方面的書籍
4樓：匿名使用者
floyd m. gardner 寫的《鎖相環技術》不錯，原來有電子版的，現在找不到了，找到了給你。
arm中pll鎖相環為什麼始終等待鎖定
5樓：網友
你好，建議你檢查下是否輸出已經超出範圍，或者你的輸入超出範圍。
嵌入式、fpga與鎖相環有什麼關係？
6樓：網友
首先說明，這僅僅是個人色彩的看法哈。 嵌入式這個東西之所以那麼火，是因為的他的需求量確實很大。 而且很多時候都用的微控制器做簡單的東西。
所以其實並不複雜。 強大的需求推動了這個有暴多培訓學校。 學校教的都是直接使用的東西，其實麼有啥技術可言， 這裡最麻煩的東西應該還演算法。
別的東西都可以累積一下。 嵌入式 應用確實多。
fpga相對也就少了點，不過也還是算常見。 主要是追求個速度時候用多，應該會有dsp+fpga的組合。我不做這個，只是粗劣知道這個計算能力上，反映速度上有優勢。
鎖相環這個用的就更少的，這個屬於純硬體的範疇，不過這東西不能算ic的最底層，我以前學過半導體物理器件。整個都是算mos 啊 什麼的裡面的 電子 空穴濃度，參雜什麼的有什麼影像，比這個還底把…… 鎖相我印象中應該在ic之上建立的，搞乙個頻率。 具體沒有深入研究過。
你應該是研究生或者博士生把。 這個東西從技術角度我沒法給你啥建議。 我僅僅是從應用角度。
哪些東西外面用的多，哪些用的少，不過要走科研道路的活，可能這個更合適把。
7樓：屬性至尊
"不像嵌入式、作業系統那些東西，連電路分析都沒學過就可以上，在培訓學校就可以學習的東西。"
嵌入式：硬體層，驅動層，系統層，應用層。
除了應用層不和硬體打交道外，其他幾個層級都和硬體有關，誰告訴你不要懂硬體就可以了。
至於你這個鎖相環技術只是晶元裡面的乙個模組，有多厲害我沒看出來，ic設計才能做出產品來，最底層硬體開發，其實就是硬體設計，不知道你是什麼學歷和學校，想做這方面的工作要求比較高，至於你說的硬體工程師不好，不知道你怎麼得出的結論，ic的核心硬體技術被國外壟斷，你可以想象一下做這個的人，過的有多好了。
什麼東西不要下結論太早，就算是做你說的這個模組，也要sw配合，不然你做的這個東西根本無法使用。
至於你說的急功近利，上層也是比不可少的，只是說難度不同，側重點不同，不明白上層和急功近利有什麼關係，不要把上層想的那麼簡單。至少要了解後在下自己的結論，等你出社會真正的工作，你就知道了。
網路上的東西要學會提煉，找到相對真實的資訊，好多都是廣告和宣傳。至於你說的這幾個的關係，fpga(plc等)網上有很多，圖書館也很多，與ic(晶元)設計有關，這個技術很是真的很牛，嵌入式前面已經說過，你可以這麼看，就是乙個裁剪過的電腦。當然會用到晶元了，鎖相環只是晶元的乙個模組，會的人很多。
8樓：
鎖相環模組本身作用是把輸出頻率穩定下來，如果你要認真**它，需要學習控制原理，它是乙個閉環系統。
但是，在嵌入式處理器、fpga裡，鎖相環本身對電路的作用，不需要你關心，因為在你操作暫存器設定模組功能的時候（比如產生pwm波），鎖相環已經悄無聲息地工作了。。。作為乙個系統設計人員，你只要讓指定模組產生你想要的邏輯功能就行了，不需要過多關心它內部怎麼產生的。。。
但是，在嵌入式處理器、fpga裡，有專門倍頻的鎖相環模組，這是個單獨的功能模組（你學過鎖相環的倍頻合成吧，它可以把乙個頻率改變到你想要的頻率），需要你去操作，就是提高系統工作頻率，比如外接25mhz晶振，用系統內部鎖相環模組4倍頻後，可以高達100mhz，這對於要求高頻的系統，就很划算了。
所以無論如何，鎖相環，只是乙個功能。並非晶元名字。
9樓：網友
鎖相環電路在arm、dsp（fpga不清楚）都有使用，並且已經整合在晶元裡，算是乙個功能模組，實際使用時只需配置相應的暫存器就行了。鎖相環還可以用在收發機中本振訊號的產生、訊號恢復、調頻訊號解調等方面。
學出來要沉澱10來年的話會很牛逼的？
怎麼牛逼？沒有處理器技術光有鎖相環技術怎麼牛逼？
要真把鎖相環技術用起來要做的事情要比鎖相環本身還難吧。
數字科斯塔鎖相環 求助
10樓：孫毛線
在計算2階環路濾波器引數的時候，需要計算係數c1、c2。我查到的公式為：c1= [1/ (k0*kd)]*8s*wn*t] /4+4s*wn*t+(wn*t)*(wn*t)]c2= [1/ (k0*kd)]*4*(wn*t)*(wn*t)] 4+4s*wn*t+(wn*t)*(wn*t)]在數字科斯塔鎖相環中，鑑相演算法採用，相位差=q*i時，鑑相增益怎麼算？
還有數控振盪器，f是驅動時脈頻率，m是相位控制字，位數為n，振盪器的增益又是怎麼算的？這兩個增益在計算環路濾波器的引數時，有用到。角頻率和阻尼係數都按照經典濾波器係數選擇這裡的兩個增益是計算的還是先根據經驗值設定的？？？
檢視原帖》
pll是什麼意思？
11樓：三月初始
pll(phase locked loop)： 為鎖相迴路或鎖相環，用來統一整合時脈訊號，使記憶體能正確的存取資料。pll用於振盪器中的反饋技術。
許多電子裝置要正常工作，通常需要外部的輸入訊號與內部的振盪訊號同步，利 用鎖相環路就可以實現這個目的。
求助 基於dsp28035的單相併網數字鎖相環程式，c語言程式設計，求大神幫助
12樓：匿名使用者
這個看硬體是什麼的。。。褲配。鄭改不是光軟體就能搞定的，去61ic**工廠看看也許有其他系列dsp相關**，最好自己寫喊純判，別偷懶。
13樓：狂得略
分給的高，但pll技術確實很難，等待高人解答~~
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