1樓：匿名使用者
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catalyst semiconductor公司推出**32k和64k器件，從而拓展了其帶嵌入eeprom儲存器的監控器。該公司的cat1320/21 (32k)和cat1640/41 (64k)監控器可支援基於微控制器系統在上電、掉電和功率過渡條件下可靠工作。
cat1320/21和cat1640/41系列產品可實現序列eeprom的64位元組頁面寫入操作，並能吵枝在同乙個i2c匯流排上堆疊多絕緩達8個器件。在上電/掉電時，這兩種器件均能提供200ms的復位暫停時間，在此期間，禁止對eeprom進行寫操作，因而可避免損壞資料。此外，這兩款器件還提供了可用作正常輸出或人工輸入的reset引腳，這一功能選擇通過內部跳線實現。
此外，這兩種產品還提供了5種閾值電壓，分別為和，其有效復位電壓可低至1v，工作電壓為到， reset引腳可用作按鈕手工復位，具有64k (cat1640/41)和32k (cat1320/21)序列eeprom，採用低功公升巨集敏率cmos和400 khz i2c介面，工作溫度範圍在-40℃到125℃之間。
cat1320/21和cat1640/41適用於主機板、家用電器、手持電子裝置和工業控制等應用領域。
cat1640/41和cat1320/21採用8引腳pdip、soic、tssop和8焊盤tdfn封裝，批量達1,000片時，cat1640/41和cat1320/21的單價分別為美元和美元(僅供參考)。這兩種器件均為無鹵素、無鉛，完全符合rohs標準的環保型封裝產品，既可提供樣品，也可批量供貨。
2樓：匿名使用者
不能調，cpu製造的時候就已經規定是32k
3樓：匿名使用者
這個做不到的 只有更換cpu了。
4樓：匿名使用者
這個 調不了，固化的。
cpu的**快取
5樓：匿名使用者
1級2級3級快取(cache)作用都是一樣的，那就是在處理器(processor)和記憶體(main memory)之間「搭起座橋」，因為記憶體和處理器的讀取速度相差很大，直接記憶體讀取比較昂貴，所以有了快取就可以把一小部分經常用到的資料放在快取裡，有效減少dma(direct memory access)。cs裡有乙個概念叫the principle of locality，有興趣可以看看。
通常來說都是快取越大越好，不過level-1 cache一般都是built into the processor chip,而其他快取要看不同的電腦，比如我core-i7 q720m的本本，level-3 cache 有6m。
cpu**快取有什麼用
6樓：庫玉芬曾詞
二樓說的是有錯誤，amd
3級快取是片外快取那是。
piipiii時代。
也就是說在1998---1999
年間的cpu產品如k5
k6k6ii等。
以半數頻率執行，在今天的cpu都是。
同步的，你說amd為擬補l2的不足，沒錯。
但是要告訴你的amd
l1做的很大。
k10都是64kb
k8是128kb
所以你對比效能會發現加大l2對。
amd沒啥用，早期的毒龍才64kb
l2快取。一級快取128kb造成。
和k7athlon
xp在同頻的情況下差距不明顯，尤其後期閃龍也是如此，1級快取現有的所有處理器沒有超過128kb的。
單核心。因為它。
難以造大，而amd
k10是多核心的當初設計的是。
4核心的。產物考慮到節能和共享快取。
才有3級快取的。
俗稱l3當處理器負載不大用不到全速執行的時候會降頻降壓，只保留乙個核心全速執行，amd
k10是有這功能的後來作業系統的。
支援不吃不良。
現象在於。當其他核心關閉或降頻。
時正好系統突然給處理器乙個滿負荷任務與第乙個核心全頻的資料不能同步導致。
會卡一下。雖然幾率很小但還是被amd遮蔽了早期的k10都有這功能，如果l2做大那麼在非滿負荷的情況下，其他核心關閉或降頻，乙個核心工作就無法發揮其他核心l2增大帶來的效果，不如l3共用即使單個核心也可以呼叫全部的l3快取這樣。
效能和電晶體的利用率。
顯著提高。更科學。不僅僅amd
英特爾的i7處理器也是有l3的。
這是多核心的必然產物。
不僅僅因為以上原因，還因為多核心的。
資料分配以及。
各種指令傳輸。
更加方便因為在l3之前還有個記憶體控制器。
以及l3單元裡還有各種調配指令資料的控制器。
要分給那個空閒的核心來執行，你可以把他的作用。
看作銀行。我們每個人單位都是乙個核心，這樣在核心越來越多的未來，l3的作用會越來越大，以後16個核心同時執行那麼l3肯定會超過12mb甚至更多，有人或許不信，你可以看啊。
英特爾的。伺服器處理器的。
至強4核心的和。
安騰處理器。
都有6--12mb的l3快取。
現在已經有了，民用消費市場也不會太遠。
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