1樓：匿名使用者
假如clk是1hz的，過一個d-ff變成0.5hz，然後將這兩個訊號接到資料選擇器上。資料選擇器的地址用另一個d-ff控制。
數位電子如何做0.1hz脈衝訊號?
2樓：斜陽紫煙
精度要求不高，可以用雙管無穩態電路實現，或555類時基電路實現
如果要求很高，就需要數字時基訊號發生電路+分頻電路來實現。
vhdl語言編寫1mhz分頻為1hz
3樓：匿名使用者
library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
entity div is
generic(n:integer :=1000000);
port (clk:in std_logic;
q:out std_logic);
end div;
architecture behave of div issignal count :integer range n-1 downto 0:=n-1;
begin
process(clk)
begin
if rising_edge(clk) thencount<=count-1;
if count>=n/2 then
q<='0';
else
q<='1';
end if;
if count<=0 then
count<=n-1;
end if;
end if;
end process;
end behave;
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