1樓：網友
如果要用自己寫的這兩個程式建立全加器，還要寫乙個主程式用component呼叫這兩個程式而且要用port map 語句把進出的管腳連線說明白，之後用這三個程式建工程 也可以 先寫half_adder,編譯通過之後點file->create/update->create symbol file for current file,變成符號元件存檔之後，之後新建原理**件(file->new->block diagram/schematic file)呼叫元件庫中的or2和half_adder,連線儲存，以這個檔案建立工程編譯，應該能行，或者寫兩個vhdl檔案，half_adder和full_adder，full_adder中用component呼叫half_adder,用這兩個檔案建工程然後編譯。
2樓：網友
如果要實現層次化設計，你先建乙個工程和平時一樣的 寫好後編譯後再在file中選擇create/update 下拉選單中選擇第二個 它會把程式打包成為乙個元件形式的模組；在新建乙個專案，路徑不變 系統會彈出乙個對話方塊 「該目錄已有專案問你是否更換路徑」選否 後面的和前面的一樣 ；最後照到上面的步驟新建乙個原理圖圖紙 在project中就有你的全加器和或門了 像連元件一樣連線起來就是了 綁引腳和平時一樣。
關於fpga頂層設計和模組設計怎麼在quartus ii裡設計實現啊
3樓：楓葉樸璐
乙個是時序約束，另乙個就是邏輯鎖定。時序約束是按照你的時序要求去佈局佈線。而邏輯鎖定則是指設計者將某個模組或者某個網路指定在器件的某個位置。
儘管有時序約束，但綜合器也不能保證每次都能達到要求；而只有當邏輯鎖定後，它能保證被鎖定的模組在下一次綜合不被改變。
事出有因，之前加進來的乙個spi模組，一開始是正常的，後來陸續在設計中加了一些模組，綜合後，居然發現spi模組工作不正常，奇怪的是，在我備份的幾個版本中，有幾個正常，有幾個又不正常，而在這個過程中spi模組從未被修改過。我想一定是綜合器在搗鬼，後來我在spi正常的版本上檢視chip
planner中spi的佈局資訊，然後將其邏輯鎖定，再新增新的模組進來，結果發現，spi果然沒有受到影響。
quartusii中在高層次設計中怎樣呼叫原件
4樓：你猜我猜哇擦猜
先把你的半加器封裝 然後就可以呼叫了 保持你半加器的介面，然後在file選單下有個creat/update
選第二個 creat symbol for current。。。然後你建立全加器時就可以呼叫了。
quartusii中的頂層設計實體是什麼意思
5樓：網友
也就是把你要進行操作的那個工程放在最頂端。
因為quartus 軟體只能對頂層工程檔案仍進行編譯。
如果你不把你講要進行操作的工程置於最頂層，軟體只能對你前一次的過程進行編譯。
取個例子，quartus軟體就像是altera公司的裡一棟辦公樓裡的某乙個部門，這個部門位於altera公司這棟辦公樓的頂樓，quartus這個部門要處理檔案時，要求其他部門親自把檔案送到頂樓來，不然就不予處理，因為altera給他的職務就是只能在你的辦公區（頂樓的那片區域）上班，而不管任何部門，不把檔案親自拿到頂層來quartus你這個部門就不給他做任何事。不然quartus軟體就會一直編譯之前拿到頂層來的檔案。
所以，在編譯工程時，注意置頂，不然有時候提示的錯誤都讓你丈二的和尚---摸不著頭腦。(*嘻嘻……
同一工程下 ，不同層次的模組怎麼輸入到quartus ii中進行編譯，詳細點啊
6樓：網友
建個工程然後把各層次的模組匯入進去，底層次的模組要在頂層模組中例化。
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