1樓：風雷小草
將輸入的並行資料暫存在內部暫存器裡，然後一位位地輸出，輸出8位後，再將外部資料拿進來更新，再輸出。這樣迴圈進行。
用verilog編寫8bit並行輸入1bit序列輸出的介面轉換模組。
2樓：
always @(posedge clk)begin
bits8_in_reg<= bits8_in;
bits8_in_reg<= ; //從高位到低位發的順序endassign serial_line = bits8_in_reg[7];
verilog8位並行輸入序列輸出移位暫存器程式
為了把序列輸入的資料轉換成並行輸出的資料,可以使用?
3樓：155024知道
74ls164是一個序列輸入、8位並行輸出的移位暫存器。並帶有清除端。
74ls595可以序列輸入、8位並行輸出，並帶有鎖存功能，
要實現16位資料串入並出，可以用2片8位的以上晶片級聯實現。
quartusⅱ裡有4位並行輸入轉成一路序列輸出的模組嗎？vhdl怎麼編寫
4樓：匿名使用者
可以直接定義四個標準邏輯位向量，然後通過&就可以實現了
5樓：匿名使用者
quartus中用匯流排設定啊
verilog實現並行輸入序列輸出，並且帶奇偶校驗位，老師課堂留的作業，不做出來不讓吃飯，救救我吧，**等
6樓：風雷小草
做這個事確實沒時間吃飯。
給函式輸入字串輸出這個字串的
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